データ駆動型制御機構付き MPLD を用いた並列処理マシン WASMIIの仮想化
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概要
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拡張MPLDチップWASMIIは,MPLDチップにデータ駆動型制御機構を取り入れることにより,大規模な演算回路を効率良く並列処理する計算機構である.WASMIIではMPLDにトークンルータ,インプットトークンレジスタ,およびページ制御機構を付加することにより,データ駆動型制御を実現している.しかし,処理可能な問題の規模がチップ内の結線情報RAMの枚数によって決められてしまうため,このサイズを越えるような問題に対処することはできない.この問題を解決し,より大規模な演算回路を実現するための技術として仮想ハードウェアを提案する.仮想ハードウェアは,MPLDの内部の結線情報RAMを切り替えて用いると共に,外部のバックアップRAMから近いうちに必要になるような結線情報のデータを,内部の使われていない結線情報RAMへ転送する機能を設けることにより実現される.本論文では,仮想ハードウェアを用いて,データフローグラフ上の演算装置を直接に実現する計算機構一仮想化WASMIIを提案し,このシステムで処理するために必要な前処理手法を述べる.そして,理論分析とシミュレーションの両面から本システムの有効性を示す.
- 1994-04-15
著者
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