アナログ集積回路での近接共通重心配置制約を考慮した配置手法の研究(配置配線,デザインガイア2012-VLSI設計の新しい大地-)
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概要
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モノリシックICは、シリコンチップ上に一体構造として作り込まれた素子の素子値の絶対誤差(素子の設計値に対する実際の値のズレ)は大きいが相対ばらつき(チップ内の素子の絶対誤差の差の最大値)は小さいことが知られている。そのため、アナログIC内で素子値の比の誤差をできるだけ小さくしたい場合、それぞれの素子を2等分割し、共通の点(共通重心)に対して点対称に配置設計することが行われる。この問題に対し、セルの相対位置が指定されたときに、複数のセル対を共通重心に対して点対称に配置する手法が幾つか提案されてきたが、共通重心にできるだけ寄せるべきなのに、ここから無駄に離れた位置にセルが配置されてしまうことがあった。そこで本稿では、共通重心配置制約を満たし、しかも共通重心にできるだけ寄せることができ、しかも簡便なデコード手法を提案し、実験によりその有用性を確認する。
- 2012-11-19
著者
-
藤吉 邦洋
東京農工大学大学院 工学府 電気電子工学専攻
-
藤吉 邦洋
東京農工大学工学部電気電子工学科
-
藤吉 邦洋
北陸先端科学技術大学院大学情報科学研究科
-
上 慧太朗
東京農工大学大学院電気電子工学専攻
-
藤吉 邦洋
東京農工大学大学院電気電子工学専攻
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