Dual-Vthセルの利用による動的リコンフィギャラブルプロセッサの漏れ電力削減手法(計算機システム)
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概要
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動的リコンフィギャラブルプロセッサにおいて,Dual-Vthセルを用いて,性能を犠牲にせずに漏れ電流を削減する方法を提案,評価した.通常のCPUなどに用いられるクリティカルパス削減ポリシーに従ったMult,Sw,MultSw,FPGAで用いられるDualエレメントポリシーを適用したMapHalf,1Row,RandHalf,これらを組み合わせたSw+Half,Mult+Halfについて3種類のアプリケーションを用いて評価した.その結果,プロセッサアレーのスイッチングエレメントにのみLow-Vthセルを用いるSwが,電力時間積を20%から28%改善可能で優れた方法といえる.Swの性能が不足する場合は,スイッチングエレメントと下半分のPEにLow-Vthセルを用いるSw+Halfを使い,アプリケーションのマッピングを最適化する方法が優れている.この方法はすべてLow-Vthセルを用いた場合に比べて遅延の増大は5〜14%で,28%の漏れ電流を削減できる.
- 2011-01-01
著者
-
天野 英晴
慶應義塾大学大学院理工学研究科
-
天野 英晴
慶應義塾大学
-
天野 英晴
慶應義塾大学理工学部情報工学科
-
佐野 徹
慶應義塾大学大学院理工学研究科
-
平井 啓一郎
慶應義塾大学大学院理工学研究科
-
齊藤 貴樹
慶應義塾大学大学院理工学研究科
-
加東 勝
慶應義塾大学理工学部
-
天野 英晴
慶應義塾大学理工学部
-
加東 勝
慶應義塾大学
-
天野 英晴
慶應義塾大学 理工学部
-
佐野 徹
慶應義塾大学
-
平井 啓一郎
慶應義塾大学
-
齊藤 貴樹
慶應義塾大学
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