ハイパフォーマンスコアとローパワーコアの組み合わせにおける細粒度動的スリープ制御の実装と評価(組込みシステムプラットフォーム)
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概要
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演算器単位の細粒度動的パワーゲーティングとコア単位の粗粒度パワーゲーティングをヘテロジニアスマルチコアプロセッサを対象として実装し、評価を行う。ハイパフォーマンスコア(HP-Core)とローパワーコア(LP-Core)は共通のISAで動作するが、HP-Coreはスーパスカラ構成であり、動作周波数も高い。各コアは16KBのL1キャッシュとTLBを持っている。評価はFujitsu 65nmのプロセスルールを用いて、性能、電力、面積とパワーゲーティングによる面積オーバーヘッドについて行った。この結果、HP-Coreでは24%の性能向上し、Dijkstra、Blowfishではリーク電力を46%削減できたが、Qucik SortとJPEGエンコードでは消費電力が63%増大した。面積オーバヘッドは平均で9.2%であった。
- 2009-01-06
著者
-
天野 英晴
慶應義塾大学大学院理工学研究科
-
関 直臣
慶應義塾大学
-
ジャオ レイ
慶應義塾大学
-
小島 悠
慶應義塾大学
-
池淵 大輔
慶應義塾大学
-
天野 英晴
慶應義塾大学
-
ZHAO LEI
慶應義塾大学
-
天野 英晴
慶應義塾大学理工学部
-
Lei Zhao
慶應義塾大学
-
Zhao Lei
慶応大
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