書き換え可能ハードウェアを用いた耐故障性能向上手法の研究(高信頼化技術・設計技術)
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概要
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近年,書き換え可能ハードウェアであるFPGA (Field Programmable Gate Array)の部分回路再構成機能が拡充されたことで,この機能を応用した様々な技術(画像処理,暗号処理,低消費電力など)が提案されている.しかし,回路構造および配置を事前に決定できかつ設計された回路が高い規則性を持つ上記のような場合とは異なり,耐故障性能向上を目的とした場合は故障個所の特定を事前に行えない.このため,従来の部分回路再構成を適用した提案手法とは異なり,任意の位置にある多種多様な故障部位を動的かつ適切な場所に再配置する高い柔軟性が要求される.そこで著者らは,以上を実現する一手法としてFPGAを利用したタイルフォールトトレラント手法(TFT:Tile-based Fault Tolerant approach)を提案している.本稿ではTFTをXilinxのVirtex5シリーズおよびVirtex IIシリーズのFPGAを用いて実装し,本手法における有効性と改善点について議論する.
- 2008-09-18
著者
-
山口 佳樹
筑波大学大学院システム情報工学研究科
-
安永 守利
筑波大学大学院システム情報工学研究科
-
川合 浩之
筑波大学大学院システム情報工学研究科
-
金丸 敦礼
筑波大学大学院システム情報工学研究科
-
山口 佳樹
筑波大学システム情報工学研究科
-
安永 守利
筑波大学システム情報工学研究科
-
安永 守利
日立中央研究所
-
安永 守利
筑波大学大学院システム情報工学
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