MOSFETのブレークダウン・スナップバック領域のマクロモデリング
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概要
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ブレークダウン領域,スナップバック領域を含んだSPICEのマクロモデルを提案する.評価のため,デバイスシミュレータの値にシミュレーション結果をフイッティングした.結果として,制御電源を並列させた簡単なマクロモデルを採用することによりブレークダウン現象の解析を実現した.さらに,シミュレーションの際にかかる時間も少なくなることがわかった.このことからマクロモデルが有用であることを示した.
- 社団法人電子情報通信学会の論文
- 1999-10-25
著者
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