電流モード多値フィールドプログラマブルディジタルフィルタの構成
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概要
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本稿では, 2進Signed-Digit (SD)数算術演算アルゴリズムと多値電流モード回路技術を用いたディジタルフィルタ専用FPGA-Field Programmable Digital Filter(FPDF)の構成を提案する. 近年, ディジタル信号処理などの応用分野において, FPGAに代表されるプログラマブルなデバイスの重要性が高まっているが, ASICに匹敵するような高速性とコンパクト性を両立させることは困難であった. これに対して, 本稿では, FPDFの内部データ表現として2進SD数系を用いることにより, 桁上げ伝搬に制限されない高速処理が可能であるとともに, このような冗長データ表現をプログラマブルデバイスに適用した場合に深刻になる配線量増大の問題を電流モード多値集積回路技術により大幅に改善できることを示す. 0.6μCMOS技術による試作の結果, 多値電流モードでFPDF構成した場合, 2値論理による同等の構成と比べて, 回路規模を41%に, 消費電力を50%に削減することが可能である.
- 一般社団法人電子情報通信学会の論文
- 1999-08-27
著者
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