DRP上での仮想ハードウェア機構の検討(FPGAとその応用及び一般)
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概要
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仮想ハードウェア機構をNEC社のDRP(Dynamically Reconfigurable Processor)上に実装する場合の方式および問題点に関して検討する。ループ構造がチップ内のコンテキストに入りきれない場合でも、部分変更を用いることができれば、コンテキストの選択的な実行、割り付けアルゴリズムと読み込みアルゴリズムの工夫により、読み込み時間を隠蔽することが可能である。離散シミュレータの実装例では、56クロックの損失を28クロックまで低減することが可能である。
- 社団法人電子情報通信学会の論文
- 2004-01-15
著者
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