マルチグレイン並列処理を利用したソフトウェア制御キャッシュの開発
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概要
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マルチグレイン並列処理は、プログラムのもつ並列性を効果的に利用することのできる並列処理手法として提案されている。このマルチグレイン並列処理は様々なアーキテクチャ上で実現可能であるが、その性能を最大限に引き出すためには、専用のアーキテクチャを用いるのが望ましい。本稿では、マルチグレイン自動並列化コンパイラをターゲットとしたマルチプロセッサASCA (Advanced Scheduling oriented Computer Architecture)の構成要素プロセッサに内蔵する新しい方式のキャッシュについて提案し、性能の予備調査を行なった。その結果、ある例では従来のキャッシュに比べ約21%性能が向上することを確認できた。
- 社団法人電子情報通信学会の論文
- 1998-04-24
著者
-
天野 英晴
慶應義塾大学大学院理工学研究科
-
岩井 啓輔
防衛大学校情報工学科
-
天野 英晴
慶應義塾大学
-
川口 貴裕
慶應義塾大学理工学部
-
森村 知弘
慶應義塾大学理工学部
-
藤原 崇
慶応義塾大学
-
藤原 崇
慶應義塾大学理工学部
-
岩井 啓輔
慶應義塾大学、現在、防衛大学校
-
坂本 勝人
日立製作所
-
森村 知弘
慶應義塾大学理工学部:(現)(株)日立製作所中央研究所
-
岩井 啓輔
慶應義塾大学
-
川口 貴裕
慶應義塾大学理工学部:(現)特許庁
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