静電気試験器における放電電流の回路論的考察
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概要
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静電気放電(EDS:ElectroStatic Discharge)で生ずる過渡電磁雑音は広帯域の周波数スペクトルをもち, ハイテク機器に深刻な電磁干渉を引き起こす.このような背景から, 電磁環境に対する機器の耐性測定法がIEC(国際電気標準会議)で取り決められ, 上述のESDについてはIEC61000-4-2において, 帯電人体による静電気放電を模擬した静電気試験法が具体的に示され, 試験器注入の放電電流波形が詳細に規定されている.しかしながら, 試験器による放電電流の決定要因には不明の点が多く, それ故にIEC規定の電流波形が実際の機器へ注入される保証はない.本文では, 放電電流の決定要因の解明を目的として, 試験器構造に立脚した等価回路モデルを提案, 同モデルの妥当性は静電気試験器による放電電流の計算波形と測定波形が概ね一致することを確認することで検証できた.
- 社団法人電子情報通信学会の論文
- 2001-12-14
著者
-
高 義礼
名古屋工業大学大学院
-
田中 秀幸
名古屋工業大学工学部
-
田中 秀幸
東京大学大学院情報学環
-
山中 幸雄
独立行政法人 情報通信研究機構
-
田中 秀幸
名古屋工業大学工学部電気情報工学科
-
藤原 修
名古屋工業大学
-
高 義礼
名古屋工業大学
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