RSFQ論理回路を用いた非同期式加算器の設計
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概要
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単一磁束量子の有無により"0", "1"の信号を表現する高速単一磁束量子(Rapid Single Flux Quantum:RSFQ)論理回路では, 大規模な集積回路の設計において回路内の各ゲートに同期したクロックを分配することが問題となる.Data-driven Self-timed(DDST)システムは各論理セル間に相補的信号を用いることでグローバルなクロックを排除する非同期方式である.本研究では2種類の4-bit DDST加算器を設計した.そして, Nbプロセスを考慮したチップ歩留まりの解析を行った.この結果DDST加算器において従来型の4-bit RSFQ加算器よりも大きい回路歩留まりが得られたことから, DDSTシステムの有効性を示すことができた.
- 社団法人電子情報通信学会の論文
- 1998-07-28
著者
-
吉川 信行
横浜国立大学大学院工学府
-
米山 薫
横浜国立大学工学部
-
米山 薫
横浜国立大学・工
-
吉川 信行
横浜国立大学 工学部 電子情報工学科
-
多胡 博史
横浜国立大学工学部
-
多胡 博史
横浜国大・工
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