多段結合網に基づく並列計算機のためのキャッシュ制御機構の実装
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概要
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多段結合網(MIN:Multistage Interconnetion Network)は, 小規模なスイッチングエレメントを多段接続した結合網で, 比較的少量のハードウェアで大規模なシステムを実現できるが, キャッシュの一致制御が難しいという問題がある. 一方, キャッシュ制御機構を効率良く実装できる多段結合網MINC(MIN with Cache coherent mechanism)が提案され, シミュレーションによる評価により, 高い性能を得られることが示されているが, データ転送とキャッシュ制御が一体化しているため, 効率良く実装することができない. そこで本論文では, キャッシュ制御のみを行なうチップを提案し, その実装について述べる. このチップではMINCに基づいたキャッシュ制御を行なうが, データ転送には別のチップを用いることができる.
- 社団法人電子情報通信学会の論文
- 1997-01-29
著者
-
天野 英晴
慶應義塾大学大学院理工学研究科
-
天野 英晴
慶應義塾大学
-
塙 敏博
慶應義塾大学理工学部
-
西村 克信
慶應義塾大学理工学部
-
亀井 貴之
慶應義塾大学理工学部
-
亀井 貴之
慶応義塾大学理工学部:(現)株式会社東芝システムlsi技術研究所
-
西村 克信
東海大学情報理工学部
-
塙 敏博
東京工科大学コンピュータサイエンス学部
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