FPGAによる組込み制御を目的としたプロセッサシステムの改良(コデザイン及びアーキテクチャ)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
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概要
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近年のLSI技術の進歩は,多くの機能を一つのLSIに集約するSoCを実用化している.さらに,少量多品種設計において,FPGA等の再構成可能な半導体を用いて,SoCの実現が行われている.LSI設計では,設計資産の再利用をするために様々な機能をIPとして用意されている.IPとしてMPUも提供されているが,カスタム化や修正を行うことが困難である.また,高機能なMPUはFPGAの資源の大半を消費してしまう.これを解決するために,HDLで記述されたMPUをFPGAに最適化・合成を行うことが必要である.著者らは,組込み用途に適した並列実行が可能なMPUを提案した.本論文では,この従来型MPUを改良した目的と手法について説明し,シミュレーション実験を行った結果を示す.
- 社団法人電子情報通信学会の論文
- 2003-11-21
著者
-
原嶋 勝美
大阪工業大学 工学部
-
久津輪 敏郎
大阪工業大学 工学部
-
久津輪 敏郎
大阪工業大学工学部電子情報通信工学科
-
久津輪 敏郎
大阪工業大学
-
久津輪 敏郎
大阪工業大学大学院
-
荒木 英夫
大阪工業大学大学院工学研究科
-
原嶋 勝美
大阪工業大学工学部電子情報通信工学科
-
原嶋 勝美
大阪府立大学工学部
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