エラー補償に基づく表参照型FPGA回路設計手法
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概要
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最近の制御回路においては、センサーから次々に送られてくるデータの値ごとに異なる機能を要求される場合が多い。この機能はソフトウェア的な手法によって実現することも可能であるが、制御回路そのものを得られた値に従い自動的に変更する方が制御回路の速度や信頼性といった面でも望ましい。このような動的に変化する回路を実現するには、ユーザの手によって実現する論理を自在に変更可能な表参照型FPGAを用いればよい。本稿では、このような目的でFPGA回路を設計する際に有用なエラー補償手続きと呼ばれる手続きを三つ提案する。これらの手続きは、回路内に生じたエラーを補償し、回路出力を正しいものにするものである。さらにエラー補償手続きを応用したFPGA回路設計手法として、FPGA回路内の結線削除と生じたエラーの修正を繰り返すことでFPGA回路を最小化する手法についても提案を行っている。最後に、本提案手法をMCNCベンチマーク回路に適用することでその有用性を示す。
- 一般社団法人情報処理学会の論文
- 1997-02-14
著者
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