電子回路シミュレーションの粗粒度/近細粒度階層的並列手法
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概要
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近年の半導体技術の進歩と共にVLSIの集積度は上昇し、回路の設計と検証に多くの時間とコストが必要になっている。中でも電子回路のシミュレーションに要する時間の短縮は重要な課題の一つである。従来より直接法を用いた電子回路シミュレーションの並列処理では、回路分割により粗粒度タスクを生成し、分割回路をプロセッサに割り当てて粗粒度並列処理を行なう方法が研究されてきた。本稿では、回路の自動分割を行ない、分割回路間での粗粒度並列処理と、分割回路内における直接解法のステートメントレベル近細粒度並列処理を、階層的に組み合わせる並列処理手法を提案する。
- 一般社団法人情報処理学会の論文
- 1995-03-15
著者
-
笠原 博徳
早稲田大学基幹理工学研究科情報理工学専攻
-
高井 峰生
早稲田大学理工学部電気工学科
-
前川 仁孝
千葉工業大学情報工学科
-
西川 健
早稲田大学理工学部:興銀システム開発株式会社
-
前川 仁孝
早稲田大学理工学部
-
伊藤 泰樹
大蔵省造幣局
-
伊藤 泰樹
早稲田大学理工学部
-
笠原 博徳
早稲田大学
-
高井 峰生
早稲田大学理工学研究所
-
高井 峰生
早稲田大学 理工学術院
-
高井 峰生
早稲田大学 理工学研究所
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