階層グルーピング対応バリア同期機構の評価(マイクロアーキテクチャ,集積回路とアーキテクチャの協創〜どう繋ぐ?どう使う?マルチコア〜)
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概要
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マルチコアプロセッサに搭載されつつある多数のコアを効率よく利用するため,ループやサブルーチンの内部の並列性を階層的に解析しタスクの定義を行い,プログラム全域の並列性を利用する階層的粗粒度タスク並列処理が提案されOSCARコンパイラに実装されている.階層的粗粒度タスク並列処理では,複数のプロセッサをソフトウェアにより階層的にグルーピングし,これらのグルーピングされたプロセッサ群に対して階層的に定義された粗粒度タスクを割り当てる.この階層的粗粒度タスク並列処理を効率よくサポートする,軽量かつスケーラブルな階層グルーピング対応バリア同期機構を開発し,NEDOリアルタイム情報家電用マルチコアプロジェクトにより開発したSH4Aプロセッサ8コア搭載の情報家電用マルチコアRP2に実装した.本稿では,この階層グルーピング対応バリア同期機構を提案すると共にRP2上で評価を行った結果について述べる.8コアを使用したAACエンコーダによる評価の結果,ソフトウェアのみによるバリア同期に対し16%の性能向上を得ることができた.
- 2008-05-06
著者
-
木村 啓二
早稲田大学基幹理工学研究科情報理工学専攻
-
笠原 博徳
早稲田大学基幹理工学研究科情報理工学専攻
-
間瀬 正啓
早稲田大学理工学術院基幹理工学部情報理工学科
-
内山 邦男
(株)日立製作所
-
白子 準
早稲田大学理工学部コンピュータ・ネットワーク工学科
-
水野 弘之
(株)日立製作所中央研究所
-
山田 海斗
早稲田大学理工学術院基幹理工学部情報理工学科
-
服部 俊洋
(株)ルネサステクノロジシステムコア技術統括部
-
伊藤 雅之
(株)ルネサステクノロジ
-
服部 俊洋
(株)ルネサステクノロジ
-
笠原 博徳
早稲田大学
-
木村 啓二
早稲田大学
-
白子 準
早稲田大学理工学術院
-
間瀬 正啓
早稲田大学
-
白子 準
早稲田大学
-
水野 弘之
(株)日立製作所
-
木村 啓二
早稲田大学理工学術院
-
間瀬 正啓
早稲田大学理工学術院
-
笠原 博徳
早稲田大学理工学術院
-
山田 海斗
早稲田大学理工学術院:(株)日立製作所
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