シングルチップマルチプロセッサ上での近細粒度並列処理 (<特集>並列処理)
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概要
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1チップ上に集積可能なトランジスタ数の増大に従い, 次世代マイクロプロセッサでは, これらのトランジスタをいかに有効に利用し, プロセッサの実効性能を向上させるかが大きな課題になっている. しかし, 現在主流のスーパースカラあるいはVLIW, それらの複合形のマイクロプロセッサでは, 命令レベル並列性等の限界によりスケーラブルな実効性能の向上が困難と考えられている. これに対して, 筆者らは従来のチップ内細粒度並列処理に加え, より並列性の大きいループイタレーションレベルの中粒度並列処理(ループ並列処理), サブルーチン, ループ, 基本ブロック間の粗粒度並列性を階層的に組み合わせて使用するマルナグレイン並列処理を実現できるシングルチップマルチプロセッサ(SCM)はスケーラブルな実効性能の向上を可能にすると考えている. 本論文では, マルチグレイン並列処理を効果的に実現できるSCM検討の第一歩として, 共有キャッシュ, グローバルレジスタ, 分散共有メモリ, ローカルメモリの近細粒度並列処理に対する有効性に関する評価を行った結果について述べる.
- 1999-05-15
著者
-
木村 啓二
早稲田大学基幹理工学研究科情報理工学専攻
-
笠原 博徳
早稲田大学基幹理工学研究科情報理工学専攻
-
尾形 航
早稲田大学理工学部電気電子情報工学科
-
岡本 雅巳
株式会社東芝
-
笠原 博徳
早稲田大学
-
木村 啓二
早稲田大学
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