C言語からVHDLへの変換における並列処理(ARC-5 : 並列処理モデル)(2004年並列/分散/協調処理に関する『青森』サマー・ワークショップ(SWoPP青森2004) : 研究会・連続同時開催)
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概要
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再構成可能コンピューティングを利用した新しい並列処理パラダイムを提案する.提案するシステムでは,Cプログラムをスレッドヘ静的に並列化し,VHDLへ変換した後,再構成可能コンピューティングシステム上で直接並列実行する.ハードウェア化されたスレッドは,再構成デバイス上で,フラグを用いた高速な同期とレジスタを用いた高速な通信によって協調動作する.並列処理の効果と同期による性能への影響を評価するために,実機上でプログラムを用いて簡単な実験を行った.その結果平均で,1.14倍の性能向上が見られ,再構成デバイス上での低オーバヘッドの同期通信は並列処理に良い効果がみられた.
- 一般社団法人情報処理学会の論文
- 2004-07-30
著者
-
山脇 彰
九州工業大学工学部
-
岩根 雅彦
九州工業大学工学部
-
下尾 浩正
佐世保工業高等専門学校
-
岩根 雅彦
九州工業大学大学院工学研究院
-
下尾 浩正
九州工業大学大学院工学研究科電気工学専攻
-
山脇 彰
九州工業大学大学院工学研究院
-
岩根 雅彦
九州工業大学大学院工学研究系
-
山脇 彰
九州工業大学大学院工学研究系
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