バス結合共有メモリ型マルチプロセッサにおけるバリア同期機構の評価(<特集>システムLSIの設計技術と設計自動化)
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概要
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同期オーバヘッドを削減するためのMCAMを用いた重複を許さない任意参加型バリア同期機構とその利用法を提案する.同期機構を搭載したバス結合共有メモリ型マルチプロセッサMDBM/FMMを用いて,線状バリア,面状バリア,および線状バリアと面状バリアの組合せである面線バリア同期の評価を行った.doacrossの評価では,線状バリア同期に対し面状バリア同期の速度向上比は平均14.3%向上し,動作解析によってバリア領域とバストラフィックの関係を明確にした.一般的な応用プログラムの評価では,線状バリアに対し面線バリア同期の速度向上比は平均6.3%向上し,面線バリア同期では同期待ちが削減されることが判明した.また複数の並列化プログラムを多重実行させ,平均ターンアラウンド時間を測定した.複数の並列化プログラムを逐次実行した場合に対し,後続する並列化プログラムを***プロセッサに埋め込み実行した場合,平均ターンアラウンド時間比が最良で13.4%向上し,最悪で46.6%低下した.同時にプロセッサへの並列化プログラムの割当てと平均ターンアラウンド時間の関係を明確にした.
- 一般社団法人情報処理学会の論文
- 2002-05-15
著者
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