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富士通研究所システムlsi開発研究所 | 論文
- チップ間高速信号伝送用イコライズ技術
- 高速DRAM用500MHz動作ノンプリチャージド・データバス方式の開発
- ±60ps位相合わせ精度の高速DRAM用多位相出力デジタル制御DLL
- Partial Response Detectionによるメモリ-プロセッサ間の低消費電力高速信号伝送方式
- 低電圧動作におけるDRAMセンスアンプ駆動方式
- 低消費電力SRAM向けチャージトランスファアンプとエンコードバス
- 低電圧センスアンプにおけるペアトランジスタばらつきの影響の検討
- マルチVth 0.35μm CMOSテクノロジ 1V 50MHz 15mW 32Kb SRAM
- リコンフィギュラブルな演算ユニットを搭載した組込み向けプロセッサの設計(システムLSIのための先進アーキテクチャ論文)
- 1a-M-2 バリスティック系電気伝導における形状効果の数値解析
- 27a-P-8 ポイントコンタクトにおけるコンダクタンスへの反射障壁の影響
- 自己電圧参照差動PRD回路を用いた高速CMOSレール・レール入力レンジ受信回路
- 差動PRD回路を用いた高速CMOS伝送回路の設計
- 容量結合形ジョセフソンメモリセルのセンス接合の応答解析
- チップ間高速信号伝送用イコライズ技術
- 一時記憶バッファ構成によるDRAMロウサイクル時間の高速化
- 一時記憶バッファ構成によるDRAMロウサイクル時間の高速化
- 一時記憶バッファ構成によるDRAMロウサイクル時間の高速化
- 高速DRAM用500MHz動作ノンプリチャージド・データバス方式の開発
- ±60ps位相合わせ精度の高速DRAM用多位相出力デジタル制御DLL