福井 正博 | 松下電器産業 半導体先行開セ
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概要
関連著者
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福井 正博
松下電器産業株式会社 半導体研究センター
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福井 正博
松下電器産業 半導体先行開セ
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田中 正和
松下電器産業株式会社半導体先行開発センター
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福井 正博
立命館大学理工学部
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築山 修治
中央大学理工学部
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築山 修治
中央大学理工学研究科
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福井 正博
立命館大学理工学部電子情報デザイン学科
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秋濃 俊郎
松下電器産業株式会社 半導体研究センター
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西本 周二
中央大学理工学部電気電子情報通信工学科
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四宮 典子
松下電器産業株式会社半導体研究センター
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福井 正博
松下電器産業株式会社半導体開発本部半導体先行開発センター
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四宮 典子
松下電器産業株式会社半導体開発本部半導体先行開発センター
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築山 修治
中央大学理工学部電気電子情報通信工学科
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雑賀 俊二
松下電器産業株式会社 半導体研究センター
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福井 正博
立命館大 理工
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玉井 大樹
中央大学理工学部電気・電子工学科
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西垣 泰男
株式会社松下ソフトリサーチ
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山本 敦志
松下電器産業株式会社 半導体研究センター
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羽山 繁
松下電器産業株式会社
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岩崎 知恵
松下電器産業株式会社 半導体研究センター
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雑賀 俊二
松下電器産業株式会社半導体研究センター
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濱脇 浩二
株式会社松下ソフトリサーチ
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羽山 繁
松下電器産業(株)半導体研究センター
-
羽山 繁
松下電器産業(株)マルチメディア開発センター
著作論文
- スタンダードセル方式ブロックの形状見積りの方法と評価
- リーフセル回路最適化手法(システムLSIの設計技術と設計自動化)
- 製造ばらつきを考慮したマクロセルレイアウト合成システム
- 統計的静的遅延解析における偽パス除去手法について
- CMOS組み合わせ回路のための相関を考慮した統計的静的遅延解析手法
- マクロセルの最適レイアウト合成システム
- レイアウトを考慮した容量/面積推定モデルおよびトランジスタサイズ最適化手法 (電子システムの設計技術と設計自動化)
- トランジスタのサイズと折り返しとの同時最適化手法
- レイアウトを考慮したトランジスタサイジングの一手法
- 屈曲ゲートを用いたレイアウト合成手法とその評価
- リーフセル合成のための一配線手法(電子システムの設計技術と設計自動化)
- リーフセル用配線システム
- リーフセル用配線システム
- シｰ･オブ･セルズ型レイアウト･アｰキテクチャの提案 : 最適なセル列高さに合わせたリｰフ･セル再合成
- VLSIのリーフセル合成に関する一手法 : コンパクション方法の開発とその評価
- VLSIのリーフセル合成に関する一手法(コンパクション方法の開発とその評価)
- 製造ばらつきを考慮したマクロセルレイアウト合成システム
- CMOS組み合わせ回路のための相関を考慮した統計的静的遅延解析手法
- CMOS組み合わせ回路のための相関を考慮した統計的静的遅延解析手法
- マクロセルの最適レイアウト合成システム
- 統計的静的遅延解析における偽パス除去手法について
- 統計的静的遅延解析における偽パス除去手法について
- レイアウトを考慮したトランジスタサイジングの一手法
- セル合成におけるトランジスタ配置手法
- 屈曲ゲートを用いたセルレイアウト最適化手法
- トランジスタのレイアウトモデルに柔軟性を持たせたコンパクション手法