梶谷 洋司 | 東京工業大学 大学院 理工学研究科 集積システム専攻
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概要
関連著者
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梶谷 洋司
東京工業大学 大学院 理工学研究科 集積システム専攻
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高島 康裕
北陸先端科学技術大学院大学
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立命館大学 理工学部電子情報デザイン学科
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泉 知論
京都大学 大学院 情報学研究科
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泉 知論
東京工業大学工学部電気・電子工学科
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倉澤 剛
東京工業大学電気・電子工学科
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横丸 敏彦
東京工業大学工学部電気・電子工学科
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畔上 謙吾
富士通研究所システムlsi開発研究所
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久保 ゆき子
東京工業大学工学部電気電子工学科
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山崎 博之
東京工業大学:(現)鉄道情報システム株式会社
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山崎 博之
東京工業大学 工学部 電気・電子工学科
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高橋 渡
東京工業大学 電気・電子工学科
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山崎 博之
東京工業大学理工学研究科集積システム
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梶谷 洋司
北九州市立大学国際環境工学部
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井上 一紀
日立超LSIエンジニアリング(株)
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久保 ゆき子
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高島 康裕
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東京工業大学大学院理工学研究科集積システム専攻
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東京工業大学工学部電気・電子工学科
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呉 中林
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三上 直人
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三林 秀樹
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稲木 雅人
東京工業大学理工学研究科集積システム専攻
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上野 修一
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松本 忠
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北陸先端科学技術大学院大学情報科学研究科
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上野 修一
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東京工業大学 大学院 集積システム専攻
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片渕 啓太郎
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畔上 健吾
東京工業大学 工学部 電気・電子工学科
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泉 知諭
立命館大学理工学部電子情報デザイン学科
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野島 隆志
東京工業大学 集積システム専攻
著作論文
- クリティカルパスのリビジットに着目した回路分割遅延改善手法の提案
- Flipにより自己変換するスタイナ木とそのVLSI最適配線への応用(電子システムの設計技術と設計自動化)
- 複数ネットの非交差配線における探索的最適化手法の提案
- 最適配線レイアウトの為のスタイナー木生成手法Elip
- 最適配線レイアウトの為のスタイナー木生成手法Flip
- BSG構造に基づく配置・概略配線同時最適化手法の提案
- VISI回路の階層設計をサポートする階層化BSGフロアプラン
- 確率的探索手法に基づく凸多角形パッキング手法の提案
- 抽象データ構造による高密度3次元パッキング手法
- 複数ネットの非交差配線における探索的最適化手法の提案
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- 最適配線レイアウトの為のスタイナー木生成手法Flip
- 凸型矩形を扱うMultiple-BSG配置手法の提案
- BSG構造に基づく配置・概略配線同時最適化手法の提案
- BSG構造に基づく配置・概略配線同時最適化手法の提案
- 座標固定モジュールを扱うBSG構造におけるモジュール配置手法の考案
- 相似拡大モデルに基づき配線領域を確保したモジュール配置手法の提案
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- 相似拡大モデルに基づき配線領域を確保したモジュール配置手法の提案
- 準同期式回路におけるスケジュールクロック木の構成
- 準同期式回路におけるスケジュールクロック木の構成
- 準同期式におけるクロック配線駆動配置
- 準同期式におけるクロック配線駆動配置
- 端子間容量行列の枝容量和最小実現の枝数最小化について(グラフ理論とその応用)
- 最小数枝付加によるk-枝連結グラフの(k+1)-枝連結グラフへの拡大構成(グラフ理論とその応用)
- 3-消去可能グラフについて(グラフ理論とその応用)
- 回路分割のためのビンパッキングアルゴリズムFFDとその拡張
- 一般構造フロアプランの面積最小化のための疑似気圧モデルと高速アルゴリズム
- 一般構造フロアプランの面積最小化のための疑似気圧モデルと高速アルゴリズム
- 一般構造フロアプランの面積最小化のための疑似気圧モデルと高速アルゴリズム
- 一般構造フロアプランの面積最小化のための疑似気圧モデルと高速アルゴリズム
- 容量を固定した整数ビンパッキング問題のFFD法による解法
- ビンの容量を制限したキューブパッキング問題のNP完全性について
- 二つのグラフの共通木グラフについて(グラフ理論とその応用)
- 枝重み付き一般グラフの最大マッチングの下限と線形時間近似アルゴリズム
- モジュールの重なりを許さない力学的モデルによるモジュール配置手法の提案
- モジュールの重なりを許さない力学的モデルによるモジュール配置手法の提案
- A-3-4 局所方向性を持つFPGAの経由スイッチ数最小化配置アルゴリズム
- フロアプランの部屋間チャネル隣接を表現するHalf-State Sequence(H-Seq)
- パラメトリックBSGによるレイアウトデザインの再利用
- パラメトリックBSGによるレイアウトデザインの再利用
- A-3-1 近接度に着目した入出力ピン配置アルゴリズム
- COMP2000-17 壁と部屋に関する位相方形分割のReduct-Seqによる数え上げ
- Reduct-Seq表現による高速な一般構造フロアプラニング
- CAS2000-15 / VLD2000-24 / DSP2000-36 Reduct-Seq表現による高速な一般構造フロアプランニング
- CAS2000-15 / VLD2000-24 / DSP2000-36 Reduct-Seq表現による高速な一般構造フロアプラニング
- クリティカルパスのリビジットに着目した回路分割遅延改善手法の提案
- 最小カットを用いて適切な部分回路を抽出するための効率的手法
- 最小カットを用いて適切な部分回路を抽出するための効率的手法
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- 疑似気圧モデルに基づくVLSIフロアプランの局所修正
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- マルチプロセッサの低消費電力化のためのクロックON/OFFスケジューリング
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- 最大フロー手法を応用した論理回路モデルグラフの最小カット列挙法と回路分割手法
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- 最大フロー手法を応用した論理回路モデルグラフの最小カット列挙法と回路分割手法
- 準同期式回路の実現に適したクロック木構成法
- 準同期式回路の実現に適したクロック木構成法
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- リソース制約付き回路分割問題に関する一考察
- 線長の総和と最大に関する均衡平面スタイナー木
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- 準同期式回路のためのクロック配線および遅延挿入手法
- 密度推定に基づく全ネット同時配線手法 : 端点成長法
- スキュー制御クロックネットワークの構成
- 準同期式回路における遅延最適化によるクロック高速化
- クロックスキュー制御によるクロック周期の最小化
- 強パス遅延テスト可能な論理回路の解析と合成