Performance analysis of 3D-IC for multi-core processors in sub-65nm CMOS technologies (集積回路)

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概要

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• 2011-01-20

著者

• 安部 恵子

  東芝 研究開発センター

• 藤田 忍

  (株)東芝研究開発センター

• 藤田 忍

  東芝 研開セ

• 野村 久美子

  東芝 研究開発センター

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