低位相雑音PLLのための位相比較器の検出感度に関する一検討(放送,EMC,一般)
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概要
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超広帯域無線システムなどの広帯域内での変復調の利用は新たな信号伝送や信号処理の可能性を秘めている.しかし,高周波化が進んだ場合には基準信号となる位相同期回路(PLL)の出力信号の位相雑音が問題となる.超広帯域高周波無線システムのためのPLLには高周波・広帯域化だけでなく低位相雑音化にも着目する必要がある.本研究では低位相雑音PLLのために, PLLを構成するサブブロックの一つである位相比較器の検出感度について検討を行った.位相比較器を構成するMOSトランジスタのW/L比を調整することで遅延時間を短くすることにより,位相比較器の検出感度が向上した.その結果, PLLの位相雑音特性の改善ができることをシミュレーションによって明らかにした.
- 2012-03-09
著者
-
萓野 良樹
秋田大学
-
萱野 良樹
秋田大学
-
井上 浩
秋田大学大学院工学資源学研究科
-
井上 浩
秋田大学 大学院工学資源学研究科
-
萓野 良樹
秋田大学工学資源学研究部電気電子工学科
-
井干 浩
秋田大学鉱山学部電気電子工学科
-
保原 秀康
秋田大学大学院工学資源学研究科
-
萓野 良樹
秋田大学大学院工学資源学研究科
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