可変順序レジスタ割り当てにおけるクロッキングパターン最小化(システムと信号処理及び一般)
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概要
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本稿では,遅延変動の下でデータパス回路のタイミング条件を保証する手法として制御ステップごとにレジスタヘの書き込み制御信号の到着に相対的な時間順序関係の変更を許すレジスタ割り当て(可変式順序制約付レジスタ割り当て)について議論する.可変式順序制約付レジスタ割り当ては従来のクロック木と比べて面積等のコストが増大する懸念があることから,クロッキングパターンというコスト関数を導入し,可変式順序クロッキングのコストを最小化する問題を定式化する.この問題の一解法として整数計画法に基づく解法を提案する.提案手法をいくつかのベンチマーク回路に適用した計算機実験結果についても併せて報告する.
- 2010-06-14
著者
-
井上 恵介
北陸先端科学技術大学院大学情報科学研究科
-
金子 峰雄
北陸先端科学技術大学院大学情報科学研究科
-
井上 恵介
北陸先端科学技術大学院大学情報科学研究科:日本学術振興会
-
井上 恵介
北陸先端科学技術大学院大学 情報科学研究科
-
金子 峰雄
北陸先端科学技術大学院大学
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