高位合成における順序制約付レジスタ割り当て(高位合成及び検証,信号処理,LSI,及び一般)
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概要
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近年の半導体プロセスの微細集積化に伴い,製造時に生じる物理的パラメータの変動や動作時の変動に起因する遅延ばらつきの問題が深刻化している.遅延ばらつきの下で回路がホールド条件を満足するための手法として,レジスタへの書き込み信号の到着時刻に相対的な順序関係を規定する手法(contra-data-direction(CDD)クロッキング)が考えられる.本稿ではCDDクロッキングを有するデータパス回路を合成する問題について議論し,データパス回路が有効なCDDクロッキングを有するためのレジスタ割り当て問題として定式化する.次に,この問題の一解法として整数計画法に基づく解法を提案し,計算機実験によりその有効性を評価する.
- 社団法人電子情報通信学会の論文
- 2008-06-20
著者
-
井上 恵介
北陸先端科学技術大学院大学情報科学研究科
-
金子 峰雄
北陸先端科学技術大学院大学情報科学研究科
-
岩垣 剛
北陸先端科学技術大学院大学情報科学研究科
-
井上 恵介
北陸先端科学技術大学院大学 情報科学研究科
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