暗号回路のFPGA実装における簡易DPA対策
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概要
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DPA対策手法の1つであるRandom Switching Logicは乱数によりゲートごとの信号遷移を均等化してデータと消費電力の相関をなくす方法である.本研究では,暗号回路をFPGAへ実装する際,ゲートごとでなく演算ごとに入出力信号の遷移確率を均等化するDPA対策を行った.ANDゲートで構成される暗号回路とDESのSBOX1個を用いた暗号回路へこの対策を適用した結果,いずれの場合もDPA耐性が向上することが分かった.この対策では,1つの演算モジュールが複数のLUT(book Up Table)に配置されることを考えると,これはFPGAのスイッチングマトリクス(Interconnect)による消費電力と回路からの情報リークの相関は大きくないことを意味する.ゲートごとでなく演算ごとにモジュール化されていればよいので,この対策の実装は簡易である.
- 社団法人電子情報通信学会の論文
- 2007-07-13
著者
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