移植性の高い実行時間予測手法の設計と実装(ARC-7:性能予測,2006年並列/分散/強調処理に関する『高知』サマー・ワークショップ(SWoPP 高知2006))
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概要
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信頼性の高いリアルタイムシステムを構築するためには,実行するタスクの最悪実行時間を把握し,デッドラインを超えないことを保障することが重要である.本論文では,タスクの最悪実行時間を予測する手法を提案する.提案手法は,GCCの中間表現であるRTLを使用して実行フローの解析を行なう.また,アーキテクチャ毎の実行時間を,実機上でコードを部分的に実行および計測し,メモリアクセスレイテンシをシミュレータを用いて予測する.本手法はアーキテクチャ依存部分がほとんど無く高い移植性を持つ.これら手法を実行時間予測システムRETASとして実装し評価する.提案手法が,SimpleScalarシミュレータやXScale, Pentium-Mにおいて安全な最悪値を予測することを示す.
- 一般社団法人情報処理学会の論文
- 2006-07-31
著者
-
石川 裕
東京大学大学院情報工学系研究科
-
山本 啓二
東京大学大学院新領域創成科学研究科
-
山本 啓二
東京大学大学院情報理工学系研究科コンピュータ科学専攻
-
松井 俊浩
産業技術給合研究所デジタルヒューマン研究センター
-
山本 啓二
東京大学大学院情報理工学系研究科
-
石川 裕
東京大学大学院情報理工学系研究科
-
松井 俊浩
産業技術総合研究所
-
松井 俊浩
産業技術総合研
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