動的再構成を用いたアプリケーションレイヤ処理エンジンの設計(ネットワーク, デザインガイア-VLSI設計の新しい大地を考える研究会-)
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概要
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本稿では, 複数のアプリケーション・レイヤタスクをFPGAで処理する際の再構成オーバーヘッドを削減する2つの手法を提案する.まず, モジュール・バージョニング法を提案する.この方式では, それぞれのタスクについてスループットとサイズが異なる複数のモジュールの中から最適なものが選択される.次に, ソフトウェア協調方式を提案する.この方式では, 処理に求められるスループットが低い場合や, 対応するFPGAモジュールがまだプログラムされていない場合に, ソフトウェアで処理を行う.これらの方式により再構成の頻度を減らしかつ, 個々の再構成のオーバーヘッドの一部を隠蔽する事が可能である.
- 社団法人電子情報通信学会の論文
- 2005-11-24
著者
-
菅原 豊
東京大学大学院情報理工学系研究科
-
平木 敬
東京大学大学院情報理工学系研究科
-
菅原 豊
Ibmトーマスj.ワトソン研究所
-
稲葉 真理
東京大学大学院情報理工学系研究科
-
稲葉 真理
東大
-
稲葉 真理
東京大学情報理工学系研究科
-
稲葉真理
東京大学
-
平木 敬
東京大学大学院情報理工学研究科
-
稲葉 真理
東京大学大学院情報理工学研究科
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