CMOS論理ゲートの充放電電流および貫通電流による消費電力の定式化とその応用
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概要
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ディジタル論理回路の動作時消費電力(PT)を簡単に見積もるために、負荷容量(C)の充放電電流による論理ゲート1個当りの消費電力(p_D)と貫通電流による論理ゲート1個当りの消費電力(p_S)を、既知であるドライバのファンアウト数(m)と対象論理ゲートのファンアウト数(n)を用いて、定式化できる.NOT、NAND、NOR、AND-NOR、OR-NAND、等各種論理ゲートに対しp_D、p_Sを定式化した.この結果、CADツールを用いずに、大規模論理回路の消費電力を容易に見積もることができるようになった.ここでは一例として8ビット桁上げ伝搬加算回路および8ビット平方根・除算回路の動作時消費電力(PT)を計算した.同回路のPTをSPICE解析でも求め、定式による計算結果とおおよそ一致することを確認した.
- 社団法人電子情報通信学会の論文
- 2002-03-01
著者
-
榎本 忠儀
中央大学大学院理工学研究科情報工学専攻
-
鹿野 裕明
中央大学理工学部情報工学科
-
鹿野 裕明
中央大学大学院理工学研究科情報工学専攻
-
原田 知親
中央大学大学院理工学研究科情報工学専攻
-
原田 知親
中央大学大学院理工学研究科情報工学
-
榎本 忠儀
中央大学大学院理学部研究科情報工学専攻
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