CMOSディジタル大小比較回路の設計, 試作, 評価
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概要
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連続する多数のデータの中から最小値あるいは最大値を求める16ビット大小比較回路を0.6μmCMOSデザインルールで設計, 試作, 評価した。比較回路の構成要素である4ビット比較器を大幅に小型化することができた。この結果, 従来では0.0276mm^2あった16ビット0.6μmCMOS大小比較回路のシリコン面積を0.0218mm^2(約4/5)に縮小できた。同様に遅延時間, 消費電力も従来回路では6.59ns, 0.363mWだったが, 改良後は5.56ns, 0.298mWとそれぞれ約9/10, 約4/5に削減された。
- 社団法人電子情報通信学会の論文
- 1998-10-15
著者
-
榎本 忠儀
中央大学大学院理工学研究科情報工学専攻
-
大橋 政芳
中央大学大学院理工学研究科
-
早船 明
中央大学大学院理工学研究科情報工学専攻
-
大橋 政芳
中央大学
-
榎本 忠儀
中央大学大学院理学部研究科情報工学専攻
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