H.263拡張INTRA符号化モードのコーデックとそのVLSIアーキテクチャ
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概要
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本稿ではH.263のオプションである拡張INTRA符号化のコーデックのVLSIアーキテクチャを提案する。拡張INTRA符号化は、H.263Version2において追加されたオプションの中でも高い圧縮効率改善をしてしているが、これらの専用回路による実装例はほとんど報告されておらず、多くがソフトウェア処理で実現されている。しかしながら、H.263は携帯用途での利用が期待されているため、専用回路化の意義は大きい。本稿ではさらに、拡張INTRA符号化処理がMPGE-4で規定される量子化処理のAC, DC予測と類似した処理であることに着目し、MPEG-4のAC, DC予測処理と共有化が可能なハードウェアアルゴリズムとそのVLSIアーキテクチャを提案する。
- 社団法人電子情報通信学会の論文
- 2000-10-16
著者
-
白川 功
大阪大学大学院工学研究科情報システム工学専攻
-
尾上 孝雄
京都大学大学院情報学研究科
-
藤田 玄
大阪大学大学院情報科学研究科
-
藤田 玄
大阪電気通信大学情報通信工学部
-
宋 学燮
大阪大学大学院情報科学研究科情報システム工学専攻
-
宋 天
大阪大学大学院工学研究科情報システム工学専攻
-
宋 学〓
大阪大学大学院工学研究科情報システム工学専攻
-
宋 天
大阪大学大学院情報科学研究科
-
宋 学〓
大阪大学大学院情報科学研究科情報システム工学専攻
-
藤田 玄
大阪大学大学院工学研究科情報システム工学専攻
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