CAS2000-14 / VLD2000-23 / DSP2000-35 MPEG-4向け省面積SA-DCTのVLSI化設計
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概要
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SA-DCTは、MPEG-4のオブジェクト符号化においてオブジェクトの境界部分の画質を向上させるアルゴリズムであるが、従来のDCTに比べて非常に複雑な回路が必要となる。本文ではDCT行列係数を外部から入力することにより、いかなる基底関数のDCTも演算可能な1×4行列演算器を用いた省面積SA-DCT/IDCTを設計した。0.35μプロセスを用い、Synopsys Deign Compilerによって合成を行った結果、全体で約4万ゲートとなり、行列演算部分は既存のSA-DCT/IDCT演算器に比べ、半分のゲート数となった。
- 社団法人電子情報通信学会の論文
- 2000-06-15
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