命令を並列に実行するCPUに対するSCCSによるコンパイラの仕様記述
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概要
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本稿では、RISCアーキテクチャを持つ命令レベル並列プロセッサに対するSCCSによるコンパイラの仕様記述手法を提案する。プロセッサを、複数の演算論理ユニットと複数のレジスタを持ち、通信によって互いに相互作用しながら計算が進行する並行システムとして定式化する。RISCプロセッサでは、コンパイラはプロセッサの内部アーキテクチャを反映した目的コードを生成する必要がある。本稿ではこの点に着目し、Milnerによって提案されているSCCSによって、プログラムとプロセッサを同じ枠組で抽象的に記述することによって、データ依存性にもとづいた並列性を満たしながら命令レベル並列プロセッサで実行可能な命令系列を導出する手法を示す。
- 社団法人電子情報通信学会の論文
- 1996-05-17
著者
-
結縁 祥治
名古屋大学大学院情報科学研究科
-
坂部 俊樹
名古屋大学大学院情報科学研究科
-
稲垣 康善
名古屋大学大学院工学研究科計算理工学専攻
-
稲垣 康善
名古屋大学
-
鈴木 晃
名古屋大学工学部情報工学科
-
Yuen Shoji
Center For Information Media Studies Nagoya University
-
結縁 祥治
名古屋大学 情報科学研究科
-
鈴木 晃
名古屋大学
-
坂部 俊樹
名古屋大学 大学院情報科学研究科
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