暗号化アルゴリズムRijndaelのハードウェア実装と評価(FPGAとその応用及び一般)
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概要
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暗号化アルゴリズムRijndaelをVLSIに実装するときの回路規模とスループットを評価した. Verilog-HDLを用いてアルゴリズムを記述し,論理合成ツールにかけて面積と遅延時間を求めた. S-Boxはcase文を用い関数テーブルとして記述した.0.35μm CMOSスタンダードセルライブラリを用いて合成した結果,128ビット鍵のRijndaelアルゴリズムが,26.3Gbpsの処理速度で実装できることが分かった.ゲート当たりスループットは2入力NAND換算で97.4Mbps/Kgateとなった.
- 2003-01-21
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