並列計算機Datarol-IIのプロセッサエレメントの構成
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概要
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純粋な命令レベルのデータ駆動計算機では,各命令毎に行われる同期処理がネックとなり演算処理部への命令供給能力が制限されるといった問題がある.我々はこれまでデータフローモデルにレジスタ記憶を導入し最適化したDatarolアーキテクチャを提案してきた.今回はDatarolにスレッドの排他的実行機構を導入し,より最適化したプロセッサアーキテクチャを提案する.また,本プロセッサはレジスタの動的ロード機構,階層化されたオペランドメモリ,負荷制御機構等の特徴を持つ.本稿ではDatarol-IIプロセッサと呼ぶ超並列計算機用のプロセッサエレメントの構成について述べ,また,ソフトウェアシミュレータを用い本プロセッサが効果的な細粒度マルチスレッド処理を実現できることを示す.
- 一般社団法人情報処理学会の論文
- 1993-08-19
著者
-
雨宮 真人
九州大学大学院システム情報科学研究院
-
日下部 茂
九州大学大学院システム情報科学研究院
-
谷口 倫一郎
九州大学大学院システム情報科学研究院
-
川野 哲生
九州大学システム情報科学研究科:(現)nttソフトウェア研究所
-
川野 哲生
九州大学大学院総合理工学研究科
-
日下 部茂
九州大学大学院総合理工学研究科
-
谷口 倫一郎
九州大学大学院システム情報科学府
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