階層化アーキテクチャによるソフトウェア無線機用モデム(無線通信技術)
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概要
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本論文では, ソフトウェア無線機におけるモデムアーキテクチャについて検討する.ソフトウェア無線機の信号処理における時間拘束性と複雑性から, 階層型モデムアーキテクチャとトリー状バス構成を提案した.また, 3GPP DS-FDDモードを評価モチーフとして提案アーキテクチャに基づく機能分割を行い, 処理量, 柔軟性について評価した.次にCPUとPLDを搭載した評価ボードを開発し, 提案アーキテクチャの規模とデータ転送によるオーバヘッドを測定した.評価ボードでは, CPUコア, Tx-HWを除き551kG, 5.1Mbitの回路規模で提案アーキテクチャを実現し, データ転送による各プロセッサのオーバヘッド量は全体の処理量の2.5%程度に収まっていることを確認した.これにより, 本アーキテクチャがCPU動作クロックの低周波数化, 処理フローの単純化を実現し, 効率的なソフトウェア無線機を構成できることを示した.
- 社団法人電子情報通信学会の論文
- 2005-04-01
著者
-
鶴見 博史
(株)東芝研究開発センター
-
向井 学
(株)東芝研究開発センター
-
旦代 智哉
(株)東芝研究開発センター
-
富澤 武司
(株)東芝研究開発センター
-
竹田 大輔
(株)東芝研究開発センター
-
和久津 隆司
(株)東芝セミコンダクター社
-
山家 陽
(株)東芝セミコンダクター社
-
宮本 幸昌
(株)東芝セミコンダクター社
-
向井 学
東芝研究開発センター
-
山家 陽
(株)東芝soc研究開発センター
-
富澤 武司
(株)東芝
-
宮本 幸昌
(株)東芝soc研究開発センター
-
和久津 隆司
(株)東芝soc研究開発センター
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