田村 泰孝 | 株式会社富士通研究所

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概要

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関連著者

• 田村 泰孝

  株式会社富士通研究所

• 田村 泰孝

  株式会社 富士通研究所

• 後藤 公太郎

  株式会社 富士通研究所

• 後藤 公太郎

  株式会社富士通研究所

• 小川 淳二

  株式会社富士通研究所

• 小川 淳二

  株式会社 富士通研究所

• 張子 誠

  株式会社富士通研究所

• 張 子誠

  株式会社富士通研究所

• 高内 英規

  株式会社富士通研究所

• 若山 繁俊

  富士通研究所システムLSI開発研究所

• 今村 健

  富士通研究所システムLSI開発研究所

• 荒木 久勝

  株式会社富士通研究所

• 齋藤 美寿

  株式会社富士通研究所

• 若山 繁俊

  株式会社富士通研究所

• 今村 健

  株式会社富士通研究所

• 若山 繁俊

  (株)富士通研究所

• 土肥 義康

  株式会社富士通研究所

• 千葉 孝也

  富士通株式会社

• 今村 健

  富士通研究所先端システムlsi研究部

• 齋藤 美寿

  富士通研究所システムlsi開発研究所

• 荒木 久勝

  富士通研

• 石田 秀樹

  株式会社富士通研究所

• 山口 久勝

  株式会社 富士通研究所

• 神田 浩一

  株式会社 富士通研究所

• 東 裕人

  株式会社富士通研究所

• 山口 久勝

  株式会社富士通研究所

• Sastry Raghu

  HAL Computer Systems

• 神田 浩一

  株式会社富士通研究所システムLSI開発研究所ネットワークSoC開発部

• 山崎 大輔

  株式会社富士通研究所システムLSI開発研究所ネットワークSoC開発部

• 山本 拓司

  株式会社富士通研究所システムLSI開発研究所ネットワークSoC開発部

• 掘中 実

  株式会社富士通研究所システムLSI開発研究所ネットワークSoC開発部

• 小野寺 裕幸

  株式会社富士通研究所システムLSI開発研究所ネットワークSoC開発部

• 神田 浩一

  株式会社富士通研究所

• 正木 俊一郎

  富士通株式会社

• 木船 雅也

  株式会社富士通研究所

• 松原 聡

  富士通エルエスアイソリューション株式会社

• Gai Weixin

  HAL Computer Systems

• Koyanagi Yoichi

  HAL Computer Systems

• Schober Richard

  HAL Computer Systems

• Chen Frank

  HAL Computer Systems

• 木船 雅也

  株式会社 富士通研究所

• 田口 眞男

  富士通株式会社第4システムlsi事業部

• 田口 眞男

  Spansion Japan

• 田口 眞男

  富士通株式会社 半導体第2事業本部

• 相川 忠雄

  富士通株式会社第4システムLSI事業部

• 鈴木 孝章

  富士通株式会社第4システムLSI事業部

• 西 敏哉

  富士通株式会社

• 河野 通有

  富士通株式会社

• 正木 俊一郎

  株式会社富士通研究所

• 千葉 孝也

  富士通東日本デジタル・テクノロジ株式会社

• 河野 通有

  富士通株式会社デバイス技術統括部

• 野中 聡

  旭川医科大学耳鼻咽喉科・頭頸部外科学講座

• 野中 薫雄

  琉球大学医学部器官病態医科学講座皮膚科

• 金井 直樹

  北見赤十字病院耳鼻咽喉科・頭頸部外科

• 森 俊彦

  株式会社富士通研究所

• 森 俊彦

  富士通研究所

• 千葉 隆也

  富士通株式会社

• 後藤 公太郎

  富士通株式会社

• 高津 求

  株式会社富士通研究所

• 松原 聡

  富士通LSIソリューション株式会社

• 安佛 英明

  株式会社富士通研究所

• 酒井 敏昭

  富士通株式会社

• 山村 毅

  富士通株式会社

• 松尾 慎一郎

  株式会社富士通研究所

• 齏藤 美寿

  株式会社富士通研究所

• 森 俊彦

  富士通

• 安佛 英明

  富士通(株)

• 小柳 洋一

  株式会社富士通研究所

• 塚本 三六

  株式会社富士通研究所

• 柴崎 崇之

  株式会社富士通研究所

• 檀上 匠

  株式会社富士通研究所

• チャイヴィパース ウィン

  株式会社富士通研究所

• 橋田 拓志

  株式会社富士通研究所

• 宮岡 弘樹

  富士通セミコンダクタ株式会社

• 星野 正格

  富士通マイクロソリューションズ株式会社

• 山本 拓司

  富士通米国研究所

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著作論文

• 高速DRAM用500MHz動作ノンプリチャージド・データバス方式の開発
• 5-6.4Gbps 12チャネルプリエンファシス及びイコライザ内蔵トランシーバ(VLSI回路,デバイス技術(高速,低電圧,低電力))
• A 0.8-1.3V 16-channel 2.5Gbps High-speed Serial Transceiver in a 90nm Standard CMOS Process
• 5-6.4Gbps 12チャネルプリエンファシス及びイコライザ内蔵トランシーバ(VLSI回路,デバイス技術(高速,低電圧,低電力))
• 10Gbpsx4-channel CMOSパラレルインターフェース(VSLI一般(ISSCC'03関連特集))
• Dual Loop PLLを用いた2.5Gbps CMOSインターフェース (「VLSI一般」)
• Multi-processingサーバ間の高速データ転送を実現する1.25Gb/s I/Oインターフェース
• Multi-processingサーバ間の高速データ転送を実現する1.25Gb/s I/Oインターフェース
• Multi-processingサーバ間の高速データ転送を実現する1.25Gb/s I/Oインターフェース
• 90nm標準CMOSプロセスを用いて試作した40Gb/s 4:1 MUX/1:4 DEMUX(VLSIの設計/検証/テスト及び一般(デザインガイア))
• 90nm標準CMOSプロセスを用いて試作した40Gb/s 4:1 MUX/1:4 DEMUX(VLSIの設計/検証/テスト及び一般(デザインガイア))
• 90nm標準CMOSプロセスを用いて試作した40Gb/s 4:1 MUX/1:4 DEMUX(VLSIの設計/検証/テスト及び一般(デザインガイア))
• 90nm標準CMOSプロセスを用いて試作した40Gb/s 4:1 MUX/1:4 DEMUX(VLSIの設計/検証/テスト及び一般(デザインガイア))
• 一時記憶バッファ構成によるDRAMロウサイクル時間の高速化
• 一時記憶バッファ構成によるDRAMロウサイクル時間の高速化
• 一時記憶バッファ構成によるDRAMロウサイクル時間の高速化
• 高速DRAM用500MHz動作ノンプリチャージド・データバス方式の開発
• データ補間回路を用いた2-tap DFE付32Gb/sデータ受信器(招待講演,アナログ,アナデジ混載,RF及びセンサインタフェース回路)

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