ビアプログラマブルデバイスVPEXにおける配線リソースと配線遅延の評価 (VLSI設計技術)

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概要

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• 2011-03-02

著者

• 堀 遼平

  立命館大学院理工学研究科

• 上岡 泰輔

  立命館大学理工学部

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