カスタムLSIの論理設計 (計測と制御のためのカスタムLSI<特集>)

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概要

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• 計測自動制御学会の論文

著者

• 南谷 崇

  東京大学

関連論文

• A Scheduling Method for Asynchronous VLSI System Design
• マルチ閾値電圧トランジスタを用いた2線2相式非同期式回路のリーク電力削減手法(遅延・電源ノイズ解析,デザインガイア2008-VLSI設計の新しい大地)
• マルチ閾値電圧トランジスタを用いた2線2相式非同期式回路のリーク電力削減手法(遅延・電源ノイズ解析,デザインガイア2008-VLSI設計の新しい大地-)
• 共有資源の優先度と電源電圧の協調制御によるチップマルチプロセッサの省電力化(マルチプロセッサ)
• プロセス変動を考慮した電流制御による低電力化手法(消費電力1,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
• 情報システム・ネットワークのディペンダビリティに関する国際会議DSN2005の報告
• 束データ方式による非同期式回路の動作合成手法の提案(デザインガアイ2006-VLSI設計の新しい大地を考える研究会)
• 束データ方式による非同期式回路の動作合成手法の提案(動作合成/データパス合成,デザインガイア2006-VLSI設計の新しい大地を考える研究会)
• プロセス二重化とプロセス対交換によるチップマルチプロセッサの高信頼化手法(ディペンダブル設計,デザインガイア2009-VLSI設計の新しい大地-)
• セルフチェッキング・システムの誤り表示について(技術談話室)
• セルフチェッキング順序回路に関する一考察
• セルフチェッキング・プロセッサ-の一構成法
• セルフチェッキング・システムにおける誤り安全性と誤り伝搬性の概念
• マルチ閾値電圧トランジスタを用いた2線2相式非同期式回路のリーク電力削減手法(遅延・電源ノイズ解析,デザインガイア2008-VLSI設計の新しい大地)
• 1 out of 4符号を用いた低消費電力非同期式回路設計(VLSI回路,デバイス技術(高速,低電圧,低消費電力))
• 1 out of 4符号を用いた低消費電力非同期式回路設計(VLSI回路,デバイス技術(高速,低電圧,低消費電力))
• A-3-7 Simulinkによるモデルベースデザイン手法を用いた効率的な組込みハードウェア開発手法の評価(A-3. VLSI設計技術,一般セッション)
• 空間的に故障率が異なる計算機クラスタシステムにおけるチェックポインティング(ディペンダブルネットワーク・分散システム,ディペンダブルコンピューティング論文)
• プロセス二重化とプロセス対交換によるチップマルチプロセッサの高信頼化手法(ディペンダブル設計,デザインガイア2009-VLSI設計の新しい大地)
• FPGA実装を想定した束データ方式による非同期式回路のフロアプラン手法の検討
• A-3-4 モデルベース設計と動作合成設計の統合環境による効率的なハードウェア開発手法の評価(A-3.VLSI設計技術,一般セッション)
• プロセス変動を考慮した電流制御による低電力化手法(消費電力1,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
• プロセス変動を考慮した電流制御による低電力化手法(消費電力1,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
• 束データ方式による非同期式回路の動作合成手法の提案(動作合成/データパス合成,デザインガイア2006-VLSI設計の新しい大地を考える研究会)
• ディペンダブルコンピューティング論文特集の発行にあたって
• インタビュー 起業の拠点づくり 東京大学・先端科学技術研究センター長 南谷崇 東京・駒場のキャンパスの周りに企業が集まり、業を興す本拠地にしていきたい (特集 経済政策の無策を憂う)
• 情報科学と計算システム (特集 という見方--自然・生命・社会現象をみる目,語ることば)
• IFIP WG10.4 Winter Meeting報告
• 非同期式VLSIシステム設計技術の現状
• カスタムLSIの論理設計 (計測と制御のためのカスタムLSI)
• m-out-of-2m符号の部分符号に対する自己検査性検査回路
• 検出不能な短絡故障の下で論理縮退故障のテスト(技術談話室)
• 阿江,菅原,増山氏の"多資源非同期式ア-ビタの一形式"〔電子通信学会論文誌D 61(11)〔′78.11〕に掲載〕に対する意見〔付 回答〕(技術談話室)
• 機能モジュ-ルによる非同期式順序回路の合成
• 中村,宇都宮両氏の「セミモジュラ非同期回路の汎用構成手順」〔電子通信学会論文誌D 58(10)に掲載〕に対する意見〔含 上記2氏による回答〕(技術談話室)
• 非同期式順序回路の万能STT状態割当
• 正論理負論理併用による非同期式順序回路の一構成法(技術談話室)
• 非同期式順序回路における遅延の影響とそのハザ-ドフリ-構成
• 通信オーバーヘッドを考慮したマルチプロセッサSoC向け低消費電力化タスクスケジューリング手法(ARC-4:スケジューリング,2006年並列/分散/強調処理に関する『高知』サマー・ワークショップ(SWoPP 高知2006))

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