並列更新指数減衰カオスタブーサーチのためのアナログ/デジタル混成ハードウェアシステムの構成
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概要
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二次割当問題を高速に解く同期更新指数減衰カオスタブーサーチを実装したアナログ/デジタル混成ハードウェアシステムが提案されている.しかし,同期更新アルゴリズムでは,全ニューロンに対する目的関数の改善量の同時計算が必要であり,これがハードウェア実装のボトルネックとなる.そこで,全ニューロンの一部である複数個のニューロンのみを同時に更新する並列更新アルゴリズムをハードウェアシステムに適用する.この際,より自由度の高いハードウェアシステムのために改良を加える.この改良型並列更新アルゴリズムを実現するためのアナログ/デジタル混成ハードウェアシステムのシステム構成を提案する.
- 一般社団法人電子情報通信学会の論文
- 2014-01-14
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