完全差動ヒステリシス2ポートVCCSカオス発振器
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概要
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ヒステリシス2P-VCCSカオス発振器の完全差動回路構成を提案する.完全差動回路化することにより,偶数次高調波歪みを抑制することができる等の利点がある.特に同相で混入するディジタルノイズに強いため,アナログ回路とディジタル回路を混載したミックスド・シグナル大規模集積回路に適している.また,通常ではシングルエンド構成を完全差動回路化することで回路構成が2倍程度になる.しかし,提案する完全差動回路構成では,元となるシングルエンド回路中の回路構成要素の出力部分を差動化することで回路全体の差動化を行うことにより,回路規模の増加を抑えている.さらに,提案する完全差動ヒステリシス2P-VCCSカオス発振回路をTSMC0.35μmCMOSプロセスを用いて集積回路化する.また,SPICEシミュレーションから得られたクワッドスクリューアトラクタ等を含む多彩なカオスアトラクタの例を示す.
- 2008-03-21
著者
-
合原 一幸
東京大学生産技術研究所
-
合原 一幸
Jst Erato合原複雑数理モデルプロジェクト:東京大学生産技術研究所
-
堀尾 喜彦
東京電機大学 大学院 工学研究科
-
合原 一幸
ERATO合原複雑数理モデルプロジェクト科学技術振興事業団
-
濱田 卓矢
東京電機大学大学院工学研究科
-
堀尾 喜彦
東京電機大学大学院工学研究科電気電子工学専攻
-
堀尾 喜彦
東京電機大学
-
合原 一幸
東京大学工学部計数工学科:科学技術振興事業団
-
合原 一幸
東京大学大学院工学系研究科
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