SD数演算を用いたRSA暗号処理回路の設計と性能評価(回路設計, FPGA応用及び一般)
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概要
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RSA暗号処理は,極めて長い語長のべき乗剰余演算に多くの時間が費やされてしまうため,暗号処理の高速化が重要な問題となる.SD(Signed-Digit)数表現を剰余演算に導入することで,桁上げ伝搬のない剰余債算を行うことができる.本論文では, RSA暗号処理の高速化のためにSD数演算を用いた剰余乗算回路を設計した.この剰余乗算回路をRSA暗号処理回路に用いて性能評価を行い,従来の2進数演算による暗号処理回路との比較によって高速性を明らかにした.
- 2013-01-09
著者
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魏 書剛
群馬大学大学院生産システム工学専攻
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魏 書剛
群馬大学大学院 工学研究科 生産システム工学専攻
-
田中 勇樹
群馬大学大学院工学研究科生産システム工学専攻
-
浅岡 隼一
群馬大学大学院工学研究科生産システム工学専攻
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