高次結合離散IDネットワークのハードウェア実装
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概要
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ニューラルネットワークを使用して、組合せ最適化問題の解探査を行う場合に陥る極小値問題を回避できるネットワークモデルとしてHC-IDネットワークが提案されている。FPGAへの実装を目的として離散時間動作するHC-IDネットワークのHDL設計を行った。今回はその結果について報告する。
- 2012-12-10
著者
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中島 康治
東北大通研
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佐藤 茂雄
東北大学電気通信研究所
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早川 吉弘
仙台高等専門学校
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中島 康治
東北大学電気通信研究所ブレインウェア実験施設:ナノ・スピン実験施設
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中島 康治
東北大学電気通信研究所
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佐藤 茂雄
東北大学電気通信研究所ブレインウェア実験施設/ナノ・スピン実験施設
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松井 孝輔
東北大学電気通信研究所ブレインウェア実験施設/ナノスピン実験施設
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佐藤 茂雄
東北大学電気情報通信研究所ブレインウェア実験説:東北大学電気情報通信研究所ナノ・スピン実験施設
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松井 孝輔
東北大学電気通信研究所ブレインウェア実験施設/ナノ・スピン実験施設
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中島 康治
東北大学電気情報通信研究所ブレインウェア実験説:東北大学電気情報通信研究所ナノ・スピン実験施設
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