ゆらぎ増幅回路を用いたオシレータベース物理乱数生成器(ポスター講演,ポスターセッション,学生・若手技術者育成のための研究会)
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概要
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本論文では、ゆらぎ増幅回路を用いたオシレータベース物理乱数生成器を提案する。65nmプロセスにて提案回路を実装し、25℃において8.4倍のゆらぎ利得を得た。また、出力ビット列の大幅な品質改善を確認した。提案回路は、分周器を利用した単純な物理乱数生成器と比較して、面積あたりのスループットを94%向上した。実装した乱数生成器の面積は6,300μm^2、スループットは2Mbpsであり、NIST乱数品質評価テストセットに合格した。
- 2011-12-08
著者
-
天木 健彦
大阪大学大学院情報科学研究科|JST CREST
-
尾上 孝雄
大阪大学大学院工学研究科情報システム工学専攻
-
天木 健彦
大阪大学大学院情報科学研究科:jst Crest
-
橘本 昌宜
大阪大学大学院情報科学研究科
-
橘本 昌宜
大阪大学大学院情報科学研究科:jst Crest
-
尾上 孝雄
大阪大学大学院情報科学研究科:jst Crest
-
天木 健彦
大阪大学大学院情報科学研究科
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