線形変換回路最適化における計算時間削減アルゴリズム
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概要
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線形変換回路は,DCT,DFTなど様々な変換で使われている回路であり,ハードウェアで実現する場合,遅延時間,回路規模をできるだけ小さくすることが要求される.そのために定数乗算器をシフトと加減算器に置き換え,同一入力における演算部を共有化する方法が提案されているが,それらの組合せ最適化問題では,係数行列のサイズの増加に伴い計算時間や最適性に問題が生じる.本研究では,入力の順序によって遅延時間,回路規模が変化するため,入力順序を組合せ最適化問題として扱う.その際,線形変換回路の係数行列を分割し解空間を絞り,合成においてシフト加減算を決定する際の探索に制限をかけ,効率的に探索を行うことにより,計算時間削減を行う方法を提案する.
- 一般社団法人情報処理学会の論文
- 2008-03-04
著者
-
佐々木 孝雄
神奈川大学工学部
-
豊嶋 久道
神奈川大学工学部
-
鈴木 麻衣
神奈川大学工学部
-
豊嶋 久道
神奈川大学ハイテクリサーチセンター:神奈川大学工学部
-
豊嶋 久道
慶応義塾大学理工学部電気工学科
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