線形変換回路の係数列合成順序を考慮した演算コスト削減アルゴリズム(グラフ,ペトリ,ニューラルネット及び一般)
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概要
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線形変換回路は、係数行列を共通の入力ごとに複数の定数乗算(multiple constant multiplication, MCM)回路に分け、その出力を互いに加算することで合成する方法が一般的である。一方で、係数行列を列ごとに扱うことにより、入力を複数に拡張したMCM回路と見なし、その係数列を合成することにより出力を互いに加算することなく回路合成することが可能である。しかし、この方法では、演算コストが係数列合成を行う順番に大きく依存するという問題がある。そこで本研究では組合せ最適化アルゴリズムを用いることによってこの問題を解決し演算コストを削減した線形変換回路の合成法を提案する。
- 社団法人電子情報通信学会の論文
- 2004-10-28
著者
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