Min-Sumアルゴリズムを用いた高速無線LANシステム用LDPC復号器の設計(FPGA/設計事例,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
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概要
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本稿では,Min-Sumアルゴリズムを用いた高速無線LANシステム用LDPC復号器を設計する.設計する復号器は,次世代無線LANシステム規格であるIEEE 802.11nに準拠したLDPC符号を使用する.また,これは符号長648,1296,1944ビットと符号化率1/2,2/3,3/4,5/6に対応した復号器である.設計した復号器の総面積は69,467,024[nm^2]となった.
- 2007-11-15
著者
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