パス遅延故障を検出可能な順序回路を構成するための状態割り当て法(テスト設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
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概要
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本稿では,パス遅延故障のテストに用いられている2パターンテストの考えを応用した,パス遅延故障を検出可能な順序回路を構成するための状態割り当て法について述べる.パス遅延故障は順序回路のレジスタの値に影響を及ぼすため,レジスタの値を観測する必要がある.本稿では,レジスタの値を観測することによって, 順序回路に発生したパス遅延故障を検出するための条件について検討する.また順序回路に対して,この条件を満たす状態遷移図や状態割り当ての方法を提案する.さらに,提案手法を用いたパス遅延故障を検出可能な順序回路の設計例を示す.ITC'99ベンチマーク回路に提案手法を適用した結果,回路の遅延時間がほとんど増加しないことを確認した.
- 社団法人電子情報通信学会の論文
- 2004-11-25
著者
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