19-8 ハイビジョンPDPシステムのフレームメモリの削減
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概要
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This paper describes an architecture of a display control unit for HDTV PDP system. A time-compressed sub-field emitting method is adopted in the display system to improve a moving picture quality. To minimize a number of memory chips, technical requirements for the memory and its control scheme are discussed. The number of external frame memory chips have been reduced from 360 using 256kb SRAM to only 8 by using 8Mb synchronous graphics RAM (SGRAM).
- 社団法人映像情報メディア学会の論文
- 1998-10-29
著者
-
国分 秀樹
NHK放送技術研究所
-
国分 秀樹
日本放送協会
-
村上 宏
NHK放送技術研究所
-
山本 敏裕
日本放送協会放送技術研究所
-
小林 希一
NHK放送技術研究所
-
小林 希一
日本放送協会放送技術研究所
-
村上 宏
日本放送協会放送技術研究所
-
山本 敏裕
日本放送協会
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